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状态机
2009-06-07
mjei
- 关于状态机的一个极度确切的描述是它是一个有向图形,由一组节点和一组相应的转移函数组成。状态机通过响应一系列事件而“运行”。每个事件都在属于“当前” 节点的转移函数的控制范围内,其中函数的范围是节点的一个子集。函数返回“下一个”(也许是同一个)节点。这些节点中至少有一个必须是终态。当到达终态, 状态机停止。
包含一组状态集(states)、一个起始状态(start state)、一组输入符号集(
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半加器
2009-06-07
mjei
- (half - adder)
能实现两个一位二进制数的算术加法及向高位进位,而不考虑低位进位的逻辑电路。
它有两个输入端,两个输出端。
半加器电路是指对两个输入数据位进行加法,输出一个结果位,不考虑数据的进位,也不产生仅为输出的加法器电路。
是实现两个一位二进制数的加法运算电路。数据输入A被加数、B加数,数据输出F和数(半加和)、进位C0。
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全加器
2009-06-06
mjei
- 一位全加器全加器是能够计算低位进位的二进制加法电路
一位全加器(FA)的逻辑表达式为:
S=A⊕B⊕Cin
Co=AB+BCin+ACin
其中A,B为要相加的数,Cin为进位输入;S为和,Co是进位输出;
如果要实现多位加法可以进行级联,就是串起来使用;比如32位+32位,就需要32个全加器;这种级联就是串行结构速度慢,如果要并行快速相加可以用超前进位加法,
超前进位加法前查阅相关
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多路分配器
2009-06-02
sylar
- 多路分配器又名数据选择器。
定义:能够将1个输入数据,根据需要传送到m个输出端的任何一个输出端的电路,叫做数据分配器,又称为多路分配器,其逻辑功能正好与数据选择器相反。
电路结构:由与门组成的阵列。
分类:1路-4路数据分配器(如74LS139)、1路-8路数据分配器(74LS138)等。
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数字系统
2009-06-02
sylar
- 数字电路又名数字系统。
定义:
用数字信号完成对数字量进行算术运算和逻辑运算的电路称为数字电路,或数字系统。由于它具有逻辑运算和逻辑处理功能,所以又称数字逻辑电路。
数字逻辑电路分类(按功能分):
1、 组合逻辑电路
简称组合电路,它由最基本的的逻辑门电路组合而成。特点是:输出值只与当时的输入值有关,即输出惟一地由当时的输入值决定。电路没有记忆功能,输出状态随着输入状态的变化而变化,类似
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数据分配器
2009-06-02
sylar
- 定义:能够将1个输入数据,根据需要传送到m个输出端的任何一个输出端的电路,叫做数据分配器,又称为多路分配器,其逻辑功能正好与数据选择器相反。
电路结构:由与门组成的阵列。
分类:1路-4路数据分配器(如74LS139)、1路-8路数据分配器(74LS138)等。
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量化
2009-06-02
sylar
- (英语:Quantization)
1.定义
所谓量化,就是把经过抽样得到的瞬时值将其幅度离散,即用一组规定的电平,把瞬时抽样值用最接近的电平值来表示。
2.量化的分类
2.1 均匀量化和非均匀量化
按照量化级的划分方式分,有均匀量化和非均匀量化。
均匀量化:ADC输入动态范围被均匀地划分为2^n份。
非均匀量化:ADC输入动态范围的划分不均匀,一般用类似指数的曲线进行量化。
非均
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时序电路
2009-06-02
sylar
- 时序逻辑电路简称时序电路
时序电路,它是由最基本的逻辑门电路加上反馈逻辑回路(输出到输入)或器件组合而成的电路,与组合电路最本质的区别在于时序电路具有记忆功能。时序电路的特点是:输出不仅取决于当时的输入值,而且还与电路过去的状态有关。它类似于含储能元件的电感或电容的电路,如触发器、锁存器、计数器、移位寄存器、储存器等电路都是时序电路的典型器件。
时序逻辑电路的状态是由存储电路来记忆和表示的。
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时序逻辑电路
2009-06-02
sylar
- 数字电路根据逻辑功能的不同特点,可以分成两大类,一类叫组合逻辑电路(简称组合电路),另一类叫做时序逻辑电路(简称时序电路)。组合逻辑电路在逻辑功能上的特点是任意时刻的输出仅仅取决于该时刻的输入,与电路原来的状态无关。而时序逻辑电路在逻辑功能上的特点是任意时刻的输出不仅取决于当时的输入信号,而且还取决于电路原来的状态,或者说,还与以前的输入有关。
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多路选择器
2009-06-02
sylar
- 多路选择器是数据选择器的别称。
在多路数据传送过程中,能够根据需要将其中任意一路选出来的电路,叫做数据选择器,也称多路选择器或多路开关。
有4选1数据选择器、8选1数据选择器(型号为74151、74LS151、74251、74LS151)、16选1数据选择器(可以用两片74151连接起来构成)等之分。
多路选择器还包括总线的多路选择,模拟信号的多路选择等,相应的器件也有不同的特性和使用方法