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VHDL-AMS 2009-05-26 sylar
即IEEE 1076.1标准。 VHDL-AMS是VHDL的一个分支，它支持模拟、数字、数模混合电路系统的建模与仿真。 http://www.eda.org/vhdl-ams/ Verilog-AMS与之类似。支持模拟、数字、数模混合电路系统的建模与仿真。 http://www.eda.org/verilog-ams/ The VHDL-AMS language is an extens